在電源噪聲的分析過程中，比較經典的方法是使用示波器觀察電源噪聲波形并測量其幅值，據此判斷電源噪聲的來源。但是隨著數字器件的電壓逐步降低、電流逐步升高，電源設計難度增大，需要使用更加有效的測試手段來評估電源噪聲。本文是使用頻域方法分析電源噪聲的一個案例，在觀察時域波形無法定位故障時，通過FFT(快速傅立葉變換)方法進行時頻轉換，將時域電源噪聲波形轉換到頻域進行分析。電路調試時，從時域和頻域兩個角度分別來查看信號特征，可以有效地加速調試進程。

　　在單板調試過程中發(fā)現一個網絡的電源噪聲達到80mv，已經超過器件要求，為了保證器件能夠穩(wěn)定工作必須降低該電源噪聲。

　　在調試該故障前先回顧下電源噪聲抑制的原理。電源分配網絡中不同的頻段由不同的元件來抑制噪聲，去耦元件包含電源調整模塊(VRM)、去耦電容、PCB電源地平面對、器件封裝和芯片。VRM包含電源芯片及外圍的輸出電容，大約作用于DC到低頻段(100K左右)，其等效模型是一個電阻和一個電感組成的二元件模型。去耦電容最好使用多個數量級容值的電容配合使用，充分覆蓋中頻段(數10K到100M左右)。由于布線電感和封裝電感的存在，即時大量堆砌去耦電容也難以在更高頻起到作用。PCB電源地平面對形成了一個平板電容，也具有去耦作用，大約作用在數十兆。芯片封裝和芯片負責高頻段(100M以上)，目前的高端器件一般會在封裝上增加去耦電容，此時PCB上的去耦范圍可以降低到數十兆甚至幾兆。因此，在電流負載不變的情況下，我們只要判斷出電壓噪聲出現在哪個頻段，那么針對這個頻段所對應的去耦元件進行優(yōu)化即可。在兩個去耦元件的相鄰頻段時兩個去耦元件會配合作用，所以在分析去耦元件臨界點時相鄰頻段的去耦元件也要同時納入考慮。